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| GIM>investigación>proyecto>ESPRIT 8370 ESIP... |
| PROYECTO: |
| | ESPRIT 8370 ESIP |
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| Título: | ESPRIT 8370 ESIP |
| Acrónimo: | |
| Financia: | ESPRIT |
| Socios: | BULL, ICL, SIEMENS-NIXDORF, PHILIPS, ZUKEN-REDAC, THOMSON, ANACAD, SYNTHESIA, CNET y TGI |
| Presupuesto: | 152000€ |
Año comienzo: | 1996 |
final: | 1998 |
| Director: | Eugenio Villar |
| Temas: |
Diseño y verificación de sistemas embebidos HW/SW
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| Personas: |
Víctor Fernández
Fernando Herrera
Pablo Pedro Sánchez
Iñigo Ugarte
Eugenio Villar
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| Descripción: | La utilización del lenguaje VHDL en síntesis obliga a un estudio de las restricciones sintácticas a imponer y del estilo descriptivo a utilizar. Nuestra participación en el proyecto nos permitió contribuir activamente a este esfuerzo internacional. En este proyecto participamos como partner asociado a TGI. Varios de los resultados fueron remitidos al IEEE como contribución al proceso de estandarización en síntesis. |
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