Grupo de Ingeniería Microelectrónica

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 Departamento de Tecnología Electrónica, Ingeniería de Sistemas y Automática Universidad de Cantabria
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Título:The Level-0 VHDL Synthesis Syntax and Semantics - 1st Part
Tipo:Articulo en revista internacional
Lugar:The VHDL Newsletter, No. 19, pp. 10-11
Fecha:1995-10
Autores: Eugenio Villar
Líneas: Diseño y verificación de sistemas electrónicos para comunicaciones
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