Grupo de Ingeniería Microelectrónica

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 Departamento de Tecnología Electrónica, Ingeniería de Sistemas y Automática Universidad de Cantabria
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Título:VHDL multi-wait descriptions for synthesis
Tipo:Articulo en revista internacional
Lugar:Working Conference of VHDL Forum for CAD in Europe, Dresden Germany, pp 59-69
Fecha:1996-04
Autores: W. Ecker
Eugenio Villar
Líneas: Diseño y verificación de sistemas electrónicos para comunicaciones
Proyectos:
ISBN:3-8265-1462-9
Fichero:
Resumen:
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