Grupo de Ingeniería Microelectrónica

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 Departamento de Tecnología Electrónica, Ingeniería de Sistemas y Automática Universidad de Cantabria
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Título:Reducing the error floor using a two-level permutation in structured eIRA LDPCs
Tipo:Publicacion en Proceedings o Actas internacionales
Lugar:XIX Conference on Design of Circuits and Integrated Systems (DCIS2008), Grenoble, France
Fecha:2008-11
Autores: Jesús Miguel Pérez
Víctor Fernández
Líneas: Diseño y verificación de sistemas electrónicos para comunicaciones
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ISBN:
Fichero:
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