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LÍNEAS DE INVESTIGACIÓN
en las que participa:
"Eugenio Villar"
Línea de investigación
Diseño y verificación de sistemas embebidos HW/SW
Utilización de VHDL en síntesis
Síntesis de comportamiento
Diseño de sistemas embebidos HW/SW
Actividad en la Plataforma Tecnológica Artemis
Actividades anteriores en Diseño de Sistemas Embebidos HW/SW
Especificación de sistemas embebidos
Actividades anteriores en Diseño VHDL
Diseño y verificación de sistemas electrónicos para comunicaciones
Formación de ingenieros en técnicas de diseño y test de circuitos VLSI
Verificación de sistemas embebidos
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